Questões de Engenharia Eletrônica

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Listagem de Questões de Engenharia Eletrônica

#Questão 424721 - Engenharia Eletrônica, Geral, CESPE / CEBRASPE, 2004, MCT, Tecnologista Pleno 2 (Código B4)

A respeito de projeto e otimização de circuitos integrados, julgue os seguintes itens.

Uma estratégia comumente utilizada na codificação de estados é minimizar a distância de Hamming entre códigos adjacentes nas transições de estado, pois é uma heurística que reduz a complexidade das funções de transição de estado em lógica de dois níveis.

#Questão 424722 - Engenharia Eletrônica, Geral, CESPE / CEBRASPE, 2004, MCT, Tecnologista Pleno 2 (Código B4)

A respeito de projeto e otimização de circuitos integrados, julgue os seguintes itens.

Um parâmetro a ser analisado na temporização de um circuito combinacional é o seu caminho crítico, ou seja, o caminho de maior atraso, o que passa pelo maior número de portas lógicas.

#Questão 424723 - Engenharia Eletrônica, Geral, CESPE / CEBRASPE, 2004, MCT, Tecnologista Pleno 2 (Código B4)

A respeito de projeto e otimização de circuitos integrados, julgue os seguintes itens.

Em sistemas VLSI síncronos, o deslizamento do relógio (clock skewing) constitui, normalmente, um problema, porém, em certos casos, ele pode ser utilizado para acelerar a vazão em estruturas do tipo pipeline.

#Questão 424724 - Engenharia Eletrônica, Geral, CESPE / CEBRASPE, 2004, MCT, Tecnologista Pleno 2 (Código B4)

A respeito de projeto e otimização de circuitos integrados, julgue os seguintes itens.

Circuitos assíncronos eliminam a necessidade de um relógio global. Esses circuitos são constituídos por módulos independentes, sincronizados aos pares por relógios locais.

#Questão 424725 - Engenharia Eletrônica, Geral, CESPE / CEBRASPE, 2004, MCT, Tecnologista Pleno 2 (Código B4)

A respeito de projeto e otimização de circuitos integrados, julgue os seguintes itens.

Circuitos autotemporizados (self-timed) podem ser utilizados para acelerar estruturas em pipeline, na medida em que reduzem o tempo médio de execução nos estágios, enquanto que no pipeline síncrono o relógio é dimensionado pelo pior caso.

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