Questões Concurso Centro Nacional de Tecnologia Eletrônica Avançada S.A. - CEITEC

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Quais das opções abaixo não fazem parte de uma especificação de um “covergroup” em SystemVerilog?

A) Um evento de clock que sincroniza a amostragem dos pontos de cobertura.

B) Um conjunto de pontos de cobertura.

C) Cobertura cruzada entre os pontos de cobertura.

D) Um conjunto de “bins” associados ao conjunto de variáveis amostradas ou transições de valores.

E) Um conjunto de processos de amostragem.

#Questão 408363 - Engenharia de Telecomunicações, Geral, FUNRIO, 2012, Centro Nacional de Tecnologia Eletrônica Avançada S.A. - CEITEC, Analista Administrativo

Dado o seguinte trecho de código em System Verilog.

...

rand bit [3:0] Instr;

rand bit [3:0] ALU_OP;

constraint todos_os_valores {

(Instr != 4’d0) -> (ALU_OP == 4’d0);

}

Qual a probabilidade de se ter Instr == 4’d0 e ALU_OP == 4’d3?

A) 1/16

B) 1/31

C) 1/256

D) 1/128

E) 0

Dado o seguinte código em System Verilog:

wire a = 1'bx;

wire b = 1'bx;

reg c,d;

initial if (a) c = 1'b0; else c = 1'b1;

initial if (b == 1'bx) d = 1'b0; else d = 1'b1;

final $display("c = %b, d = %b", c,d);

Qual a saída do programa acima?

A) c = 1, d = 1.

B) c = x, d = 0.

C) c = 0, d = 0.

D) c = 0, d = x.

E) c = x, d = x.

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