101
Q408370
102
Q408368
Dado o seguinte código em System Verilog:
wire a = 1'bx;
wire b = 1'bx;
reg c,d;
initial if (a) c = 1'b0; else c = 1'b1;
initial if (b == 1'bx) d = 1'b0; else d = 1'b1;
final $display("c = %b, d = %b", c,d);
Qual a saída do programa acima?
103
Q408366
Quais das opções abaixo não fazem parte de uma especificação de um “covergroup” em SystemVerilog?
104
Q408364
Quais das seguintes estruturas não é parte da linguagem SystemVerilog, de acordo com o padrão IEEE 1800-2009?
105
Q408361
Dado o seguinte trecho de código em System Verilog. ... rand bit [3:0] Instr; rand bit [3:0] ALU_OP; constraint todos_os_valores { (Instr != 4’d0) -> (ALU_OP == 4’d0); } Qual a probabilidade de se ter Instr == 4’d1 e ALU_OP == 4’d0?
106
Q408360
Dado o seguinte pedaço de código em SystemVerilog. ... rand logic [15:0] x,y,z; constraint todos_os_valores { x < z; y == x; z < 500; y > 490; } Quantas soluções diferentes o resolvedor de restrições do simulador irá gerar?
107
Q408358
O que não deve ser randomizado em um testbench aleatório por restrições (constrained-random simulation)?
108
Q408356
Qual o resultado da simulação do código abaixo, quando compilado com um simulador que suporta SystemVerilog 2009? module test; logic [32:0] o = 'bx; initial $display("o = %b", o); endmodule
109
Q408346
Em um microprocessador, existem diversos tipos de endereçamento para acesso à memória de dados. Na instrução em assembly MOV AX , 2345h, em que AX é um registrador de 16 bits, o modo de endereçamento utilizado é
110
Q408345
111
Q408343
Em um código Verilog, considere as entradas a, b e c, respectivamente, com os valores 3’b111, 5’b1x001 e 3’b1zx. O valor de {a, b, c} é de
112
Q408341
113
Q408340
114
Q408338
O número 136, em decimal, pode ser representado, utilizando-se 8 bits em linguagem Verilog, por:
115
Q408336
Sobre o projeto de chips de circuitos digitais, analise as afirmações a seguir: I) Uma das abordagens de projeto de circuitos digitais é a Top-Down, em que se definem em verilog módulos de alto nível, a serem divididos em níveis menores. II) Durante o projeto de um circuito combinacional, no processo de síntese, é possível, para tal ferramenta, traduzir retardos inseridos em verilog e transformá-los em retardos físicos na implementação do circuito. III) Para se sintetizar um circuito combinacional, usando-se uma diretiva always, é necessário que todas as entradas do módulo façam parte da lista de sensitividade. Assinale a opção que apresenta as apenas afirmativas corretas.
116
Q408334
117
Q408333
118
Q408331
Ao se definir em um projeto de um Circuito Integrado de Aplicação Específica (ASIC – “Application Specific Integrated Circuit”) as interconexões dos sinais de relógio (clock), um dos problemas a ser resolvido é o chamado “clock skew”. Dentro desse contexto, analise as asserções a seguir e assinale a opção correta: I - O “clock skew” ocorre devido à diferença de tamanho dos percursos que o sinal de clock percorre antes de alimentar as células lógicas de um circuito. II - Na realização das interconexões do sinal de clock de um projeto de um ASIC, podem ser inseridos buffers especiais controlando o atraso inserido em cada linha da árvore de clock.
119
Q408329
Tendo em vista o fluxo de implementação de um projeto digital de um Circuito Integrado de Aplicação Específica (ASIC – “Application Specific Integrated Circuit”), pode-se afirmar que o processo de “Floorplanning”
120
Q408327
O número de flip-flops tipo D necessários para se construir um contador Johnson com módulo 16 é
121
Q408325
122
Q408324
Considere um circuito combinacional decodificador que aceita 32 combinações diferentes de entrada. Para esse circuito, o número de entradas e saídas é, respectivamente,
123
Q408322
124
Q408320
Escolha a alternativa que complete corretamente a seguinte afirmação: “A função lógica ___________ e a __________ implementam a mesma lógica entre os sinais A, B, C e D, uma vez que a segunda é uma simplificação da primeira.
125
Q408319
Usando a figura da Questão 47, determine o tempo mínimo de atraso na lógica combinacional.
126
Q408316
Considere os seguintes efeitos: 1) Da variação da espessura do dielétrico entre as camadas de metal. 2) Decréscimo do yield. 3) Aumento das capacitâncias de acoplamento. 4) Degradação do desempenho (tempo). O metal fiel é uma técnica utilizada para reduzir quantos desses efeitos?
127
Q408314
Sobre o IR Drop e as técnicas para a minimização do seu impacto, é correto afirmar o seguinte:
128
Q408312
Com relação às spare cells, pode-se afirmar que:
129
Q408310
A 'Síntese Física' é o processo no qual há uma realimentação do projeto físico para a síntese. Sobre essa operação é correto afirmar o seguinte:
130
Q408309
Com relação à incerteza do clock, considere as afirmativas: I – O atraso de propagação contribui para a incerteza do clock. II – O clock skew não influencia na incerteza do clock. III – O clock jitter contribui para a incerteza do clock. Está correto APENAS o que se afirma em
131
Q408307
132
Q408305
Uma empresa de CI planeja lançar um microcontrolador que possui diversos periféricos, como conversores AD e DA, SPI, USB, I²C e memórias. Durante a fase de testes em laboratório, detectou-se que o microcontrolador funcionou corretamente com todos os periféricos. Porém, quando os dados foram enviados para USB, mesmo não sendo utilizados, provocaram uma pane geral no chip. O caso descrito pode ser caracterizar como
133
Q408304
Durante a etapa de síntese, diversas modificações são realizadas na estrutura do circuito para que as restrições do projeto sejam atingidas. Existem também especificações de projeto que são colocadas nessa fase, como multi-cycle path ou false path. Alteram algumas estruturas, mas não a funcionalidade do sistema. As ferramentas de síntese podem gerar um script contendo essas informações, que serão usadas em
134
Q408302
Com relação às etapas do fluxo de projeto, considere as afirmativas abaixo: I – Floorplanning é o processo de posicionar as células em locais apropriados dentro do chip. II – Na análise estática de tempo (STA), o projetista cria vetores de teste que são simulados utilizando a gate-level netlist para verificar os requisitos de tempo. III – Na etapa de floorplannig ocorre o planejamento das linhas de alimentação do chip. Está correto APENAS o que se afirma em:
135
Q408295
Sobre retime durante a fase de síntese, pode-se afirmar o seguinte:
136
Q408294
Sobre clock skew, é correto afirmar que
137
Q408290
Uma forma de corrigir problemas de violação de hold pode ser o seguinte:
138
Q408287
Por que a técnica de clock gating afeta substancialmente o consumo de um circuito digital?
139
Q408285
Em que consiste o efeito “Antenna” e como se pode eliminá-lo?
140
Q408283
O que visa a técnica de Multi-supply voltage, e qual o mecanismo empregado?
141
Q408281
O que visa a técnica de Multi-Vt, e qual o mecanismo empregado?
142
Q408280
A função da entrada ENABLE (habilitar) em um circuito integrado multiplexador é a de
143
Q408278
Quatro flip-flops JK estão conectados em cascata por suas saídas Q, com suas entradas J e K constantes em nível alto. Se a frequência de relógio no primeiro flip-flop é de 400 kHz e se a entrada de relógio nos flip-flops é invertida, a frequência de saída é igual a
144
Q408276
As seguintes assertivas constituem características comuns aos contadores síncronos em anel e em anel torcido ou de Johnson, EXCETO:
145
Q408274
A única diferença entre os flip-flops JK e RS, no que concerne ao seu funcionamento, consiste no fato de que
146
Q408272
147
Q408268
Considere a operação do software Analog Design Environment a partir da sua janela principal. Deseja-se configurar um estímulo a um circuito. Sobre essa ação, considere as alternativas abaixo. A alternativa FALSA é a que diz que
148
Q408266
A linguagem VerilogAMS HDL (Analog and Mixed-Signal Extensions to Verilog Hardware Description Language) estende as características de uma linguagem de modelagem digital para prover uma linguagem unificada com semânticas analógicas e digitais e com compatibilidade retroativa. A respeito da linguagem VerilogAMS HDL, a afirmação FALSA é que contém as informações de que
149
Q408259
Considerando as etapas básicas do processo de fabricação CMOS (Complementary Metal-Oxide-Semiconductor) cavidade “n”, a etapa ou passo na qual são definidas as regiões ativas do dispositivo CMOS chama-se:
150
Q408012
151
Q409247
A potência do sinal absorvida em um resistor de 1
é igual a 62,5 W.
152
Q409245
Considerando que os sinais s1(t) e s2(t), nos gráficos acima, representem tensão elétrica, julgue os itens subsecutivos.
A densidade espectral de energia do sinal s2(t) é igual à densidade espectral de energia do sinal s1(t).
153
Q409099
Sobre dispositivos semicondutores de potência, considere as afirmativas a seguir.
I - O diodo e o SCR são dispositivos que são capazes de conduzir corrente em apenas um sentido e bloquear a condução no sentido oposto.
II - Ao contrário do diodo, o SCR pode ser operado como uma chave, onde a tensão de porta permite comandar a abertura e o fechamento da chave.
III - Assim como um SCR, um DIAC funciona como uma chave comandada por um sinal aplicado ao terminal de porta, sendo capaz de conduzir nos dois sentidos.
Está correto o que se afirma em
154
Q409098
155
Q409096
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Q409094
157
Q409093
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Q409091
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Q409089
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Q409088
161
Q409086
162
Q409085
163
Q409083
164
Q409082
As chaves semicondutoras de potência são os principais elementos constituintes dos circuitos aplicados em eletrônica industrial. Com objetivo de evitar a condução indevida dessas chaves, na ocorrência de variações abruptas de tensão em seus terminais, circuitos auxiliares podem ser empregados em paralelo, com cada uma das chaves. Esses circuitos são denominados
165
Q409080
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Q409079
167
Q409077
168
Q409075
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Q409074
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Q409072
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Q409070
172
Q409069
173
Q409067
As figuras I e II acima mostram, respectivamente, um circuito retificador em ponte e outro denominado retificador transformador com centro. Ambos são alimentados no primário por meio de fonte senoidal. A fonte de alimentação do circuito da figura I apresenta tensão eficaz igual a 120 V, enquanto, no circuito da figura II, essa tensão eficaz de alimentação é igual a 127 V. A partir dessas informações, julgue os itens que se seguem.
Nos terminais da carga RL, em ambos os circuitos, observam-se formas de onda com retificação completa.
174
Q409066
Considerando as portas lógicas ilustradas nas figuras de I a IV acima, julgue os itens a seguir.
Na situação em que as entradas A e B das portas (II) e (III) recebem os mesmos sinais, as saídas das respectivas portas são iguais.
175
Q409064
A figura acima ilustra aspectos construtivos e de circuitos de um transformador monofásico com dois enrolamentos. No esquema representado na figura, Np e Ns correspondem ao número de espiras nos enrolamentos primário e secundário, respectivamente, e a impedância de carga conectada ao secundário é ZL. Com base nessas informações e considerando que o transformador seja ideal, julgue os itens a seguir.
Se Np = 1.100 e Ns = 100, para uma tensão senoidal vg de amplitude 220 V aplicada ao enrolamento primário, a tensão na carga vL apresenta amplitude igual a 11 V.
176
Q409062
O valor de pico da tensão é igual a 10 V.
177
Q409061
A figura acima ilustra um esquema de ligação de componentes de um circuito elétrico que serão utilizados em um experimento. Nesse circuito, estão presentes uma bateria, um reostato, uma bobina e um amperímetro, todos ligados em série e supostamente ideais. Com base nessas informações e na figura, julgue os itens a seguir.
A indução magnética na bobina é inversamente proporcional ao aumento da intensidade de corrente.
178
Q409059
Julgue os itens a seguir acerca da identificação de problemas na cadeia de áudio.
A realimentação ou microfonia ocorre quando um sinal é capturado pelo microfone, amplificado e novamente capturado pelo microfone, dando início a um ciclo de captação e amplificação do mesmo sinal, constituindo, assim, o que se denomina loop. A amplitude desse sinal tem crescimento gradativo e é prejudicial a alto-falantes e circuitos eletrônicos.
179
Q409058
Com relação ao funcionamento e à utilização dos equipamentos de áudio, julgue os próximos itens.
A relação sinal/ruído e a resposta em frequências do microfone variam com as impedâncias da fonte e da carga e também com a capacitância dos cabos inseridos entre os circuitos. Para melhorar essa relação, utiliza-se sistema com duas, três ou até mesmo quatro consoles de mixagem ligadas em série.
180
Q409056
Julgue os itens subsequentes, a respeito das unidades de medida em áudio.
A impedância de entrada de um amplificador é medida em ohm, com valores que variam conforme sua categoria e função principal. Uma baixa impedância permite elevada captação de ruído eletrostático do cabeamento e causa microfonia.
181
Q409054
Com relação a sistemas de áudio, julgue os itens a seguir.
O amplificador eletrônico é um aparelho que eleva os níveis de tensão dos sinais de áudio. Ele é comumente utilizado em transmissores e receptores de rádio e televisão, em equipamentos estéreo de alta fidelidade (high-fidelity ou hi-fi), computadores, equipamentos eletrônicos digitais e instrumentos musicais elétricos.
182
Q408210
183
Q408209
184
Q408207
185
Q408205
186
Q408203
187
Q408201
As portas lógicas do tipo XOR (OU EXCLUSIVO) são circuitos digitais que correspondem, em sua essência, a um circuito:
188
Q408199
189
Q408198
Com relação à construção de contadores digitais com base em flip-flops, considere as seguintes afirmativas: 1. Após o RESET foram aplicados sete pulsos à entrada de um contador BCD, o que o faz passar ao estado 0111. 2. Para implementar um contador binário capaz de contar até 3.999, são necessários 13 flip-flops JK. 3. A capacidade máxima de contagem para cinco contadores BCD ligados em cascata é de 99.999. 4. O estado de um contador binário com flip-flop JK muda quando a entrada CK vai de 1 para 0. 5. Um contador binário composto de três flip-flops JK é capaz de contar até o decimal 8 (oito). Assinale a alternativa correta.
190
Q408196
Um contador binário construído com o emprego de seis flip-flops do tipo JK é capaz de dividir a frequência do sinal digital aplicado à sua entrada por:
191
Q408195
Um contador binário assíncrono de 4 bits apresenta na saída o número 1010. São aplicados quatro pulsos à sua entrada. O novo valor apresentado pelo contador será:
192
Q409244
Amplificadores de classe C eficientes podem ser usados para amplificar a potência de um sinal FM, sem que isso degrade a informação contida no sinal FM. Para amplificar a potência de sinais AM sem degradar a informação, é preciso usar amplificadores lineares de classe A ou AB, que são muito menos eficientes na conversão de potência CA ou CC para potência de RF.
193
Q409052
O circuito lógico equivalente à saída "S" do multiplexador de 8 entradas de informação e 3 de endereço mostrado abaixo tem como equação:
194
Q409051
Suponha que o estado inicial de Q0 e Q1 (S) no circuito a seguir, seja igual a zero. Sabendo-se que os flip-flops são sensíveis à borda de descida do pulso de clock, qual a função executada pelo circuito?
195
Q409049
Determinar as condições de entrada (A, B, C) necessárias para gerar uma saída x = 1 no circuito mostrado na figura:
196
Q409048
resultado da simplificação da expressão booleana 
será:
197
Q409046
Uma Unidade de Central de Processamento de um microprocessador deve possuir um conjunto de portas lógicas dedicadas que armazenam dígitos binários simples que são automaticamente "setados" ou "resetados" de acordo com o resultado das operações da Unidade Lógica Aritmética. Cada dígito binário destas portas lógicas dedicadas é chamado:
198
Q409045
Assinale abaixo a única alternativa que determina a expressão booleana simplificada de:
199
Q409043
O resultado da conversão do número decimal 3547910 em hexadecimal será de:
200
Q409042
A representação do número +9710, utilizando a notação sinal modulo será de:
201
Q408953
Um controlador lógico programável (CLP) não tem
202
Q409026
A figura acima ilustra um esquema de aterramento para a proteção de equipamentos de informática, alimentados por um sistema trifásico de 380 / 220 V. Nesse esquema, a resistência de aterramento da fonte de alimentação trifásica é igual a 10 
e a resistência de aterramento da massa é igual a 20 .
Considerando essas informações, julgue os itens subseqüentes.
Na situação mostrada, o valor da intensidade de corrente de curto-circuito não permite o uso de dispositivos de proteção contra sobre...
203
Q409024
A figura acima ilustra um esquema de aterramento para a proteção de equipamentos de informática, alimentados por um sistema trifásico de 380 / 220 V. Nesse esquema, a resistência de aterramento da fonte de alimentação trifásica é igual a 10 
e a resistência de aterramento da massa é igual a 20 .
Considerando essas informações, julgue os itens subseqüentes.
A figura ilustra o esquema de aterramento denominado TT, uma das classificações básicas dos sistemas de aterramento, que também podem...
204
Q409023
O desempenho dos sistemas de comunicação é limitado pela ocorrência de ruído e interferência. No caso de EMI (electromagnetic interference), a maneira mais eficiente de se reduzir esse tipo de interferência é eliminando ou reduzindo a fonte de radiação. Considerando a figura acima, que ilustra uma linha de dois fios terminada por uma carga, julgue os próximos itens, com relação a EMI e a maneiras de reduzir a interferência inserida ou provocada por esses fios em sistemas de comunicação.
Em um sistema de comunicação que usa fios condutores como o mostrado na figura, o sinal que carrega a informação é denominado modo diferencial. Nesse modo, ...
205
Q409021
Julgue os itens a seguir, com relação a transformador de tensão ideal.
Caso a potência nominal do autotransformador ilustrado na figura a seguir seja igual a 25 kVA, a carga máxima que esse transformador poderá alimentar é superior a 100 kVA.
206
Q409020
Com relação ao sistema WCDMA especificado pelo 3GPP, julgue os itens de 118 a 124.
Em sistemas WCDMA, a dispersão da energia do sinal transmitido devido ao atraso dos múltiplos componentes espalhados no ambiente entre transceptores é mitigada, em parte, pelo uso do receptor Rake. A figura a seguir ilustra o diagrama de blocos de um receptor que implementa corretamente os princípios básicos do receptor Rake com 3 fingers. Tecnologias ASIC (application specific integrated circuits) e DSP (digital signal processor) são empregadas na implementação física de receptores Rake atuais.
207
Q409018
Considerando a figura acima, que ilustra um circuito digital síncrono contendo três flip-flops, cujo sinal de clock é uma onda quadrada simétrica, julgue o próximo item.
A equação lógica para a entrada
208
Q409017
No circuito ilustrado na figura acima, o amplificador operacional é ideal, R = 20 k
, C1 = 100 pF e C2 = 0,01 F. Com relação a esse circuito, julgue os itens a seguir.
209
Q409015
No circuito ilustrado na figura acima, o amplificador operacional é ideal, R = 20 k
, C1 = 100 pF e C2 = 0,01 F. Com relação a esse circuito, julgue os itens a seguir.
210
Q409014
Componentes eletrônicos, a exemplo dos amplificadores empregados em redes de TV a cabo, geram ruído na banda do sistema, o que pode limitar o desempenho da comunicação. O analisador de rede vetorial (ARV) pode ser usado para avaliar os parâmetros desse componente eletrônico, conforme esquematizado na figura acima. Nesse esquema, as impedâncias do ARV e de um amplificador sob teste estão indicadas, e, para o casamento de impedância entre o ARV e o referido amplificador, empregam-se duas redes de 5,7 dB de perdas cada. A partir dessas informações, julgue os itens a seguir.
Caso, ao se medir o parâmetro S21 do referido amplificador, o ARV tenha indicado u...